Cadence SMV公司

Cadence SMV是一个符号模型检查工具,允许您正式验证有限状态系统的时序逻辑属性,例如计算机硬件设计。这意味着,您可以针对所有可能的输入序列验证您的设计,而不是编写模拟向量或模拟测试台。虽然形式验证通常等同于等价性检验,但模型检验实质上更一般。它允许您在设计过程的早期通过构建抽象的系统级模型来验证您的规范是否正确。它的使用贯穿于设计精化过程,允许您验证RTL级设计是否正确实现了高层模型。


zbMATH中的参考文献(参考文献27条)

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