验证

Verics(Verics)是我们的原始工具,用于自动验证用规范语言Estelle编写的时间自动机和协议,它是波兰科学院计算机科学研究所(ICS-PAS)研究项目“时间相关系统自动验证”的一部分。作为Verics的输入,可以使用Estelle规范、我们原始中间语言(IL)的规范或Kronos格式的时间自动机。规范可以转换为时间自动机,并传递给其他Verics组件。有关输入的示例,请参阅此处今天的内容,可访问性分析是可用的。为了证明安全性,采用了一种新的有效方法,将时间自动机的可达性问题转化为命题公式的可满足性问题(SAT问题)。为了证明正确性,对系统的抽象模型进行了(动态)可达性分析。


zbMATH中的参考文献(参考 32篇文章 引用,1标准件)

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按年份排序(引用)
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