第条

RISC和VLIW DSP的统一处理器体系结构

作者:

恰县线路接口单元,

Pi-Chen公司肖,

Chih-Wei先生线路接口单元、和

钱伟（Chein-Wei）珍作者信息和声明

GLSVLSI'05：第15届ACM大湖超大规模集成电路研讨会论文集

2005年4月

页50-55

https://doi.org/10.1145/1057661.1057675

出版:2005年4月17日出版历史

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摘要

本文提出了一种具有两种操作模式的统一处理器内核。处理器内核在RISC模式下作为一个编译器友好的类MIPS内核工作，在DSP模式下是一个4路VLIW，它具有分布式乒乓球注册组织针对流处理进行了优化。为了最小化硬件，DSP模式没有程序流的控制结构，而数据操作RISC指令在DSP数据路径中执行。此外，通过分层指令编码，这也有助于显著减少VLIW代码的大小。该处理器采用UMC 0.18um CMOS技术实现，核心尺寸为3.23mmx3.23mm，包括32KB的片上存储器。它可以在208MHz下工作，同时消耗380.6mW平均功率。

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https://dl.acm.org/doi/10.1007/978-3-031-21867-5_2
侯毅他H杨X郭D王X傅J邱克(2016)FuMicro公司超大型积体电路设计10.1155/2016/87879192016(2)在线发布日期：2016年12月1日
https://dl.acm.org/doi/10.1155/2016/8787919
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RISC和VLIW DSP的统一处理器体系结构
1. 计算机系统组织
  1. 体系结构

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GLSVLSI’05：第15届ACM大湖区超大规模集成电路研讨会会议记录

2005年4月

518页

十亿英镑：1595930574

内政部：10.1145/1057661

总主席：
约翰·拉赫
弗吉尼亚大学
,
课程主席：
港区
马里兰大学帕克分校
,
耶希亚·伊斯梅尔
西北大学

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GLSVLSI05型

主办单位：

GLSVLSI05：2005年大湖区超大规模集成电路研讨会

2005年4月17日至19日

伊利诺伊州，芝加哥，美国

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